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      數(shù)字電路與邏輯設(shè)計(jì)鄒紅著課后答案下載

      時(shí)間:2022-11-23 04:33:22 課后答案 我要投稿
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      數(shù)字電路與邏輯設(shè)計(jì)(鄒紅著)課后答案下載

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        數(shù)字電路與邏輯設(shè)計(jì)(鄒紅著):內(nèi)容簡(jiǎn)介

        本書(shū)內(nèi)容精練、實(shí)例豐富,應(yīng)用性強(qiáng),并附有習(xí)題解答,便于教學(xué)和自學(xué)。本書(shū)可作為高等學(xué)校通信、信息、光電、計(jì)算機(jī)、自動(dòng)化、電子、電力系統(tǒng)及自動(dòng)化等電類(lèi)專(zhuān)業(yè)和機(jī)電一體化、生物技術(shù)等非電類(lèi)專(zhuān)業(yè)的本科和專(zhuān)科學(xué)生電子技術(shù)基礎(chǔ)課程的`教材。也可以供從事電子技術(shù)、計(jì)算機(jī)應(yīng)?與開(kāi)發(fā)的科研人員和工程技術(shù)人員學(xué)習(xí)參考,還適于初學(xué)者自學(xué)使用。

        數(shù)字電路與邏輯設(shè)計(jì)(鄒紅著):目錄

        第1章 數(shù)字邏輯基礎(chǔ)

        1.1 數(shù)制和代碼

        1.1.1 十進(jìn)制數(shù)和二進(jìn)制數(shù)

        1.1.2 十六進(jìn)制和八進(jìn)制

        1.1.3 不同進(jìn)制數(shù)之間的轉(zhuǎn)換

        1.1.4 二進(jìn)制符號(hào)數(shù)的表示法

        1.1.5 二進(jìn)制代碼

        1.2 邏輯運(yùn)算

        1.2.1 基本邏輯運(yùn)算

        1.2.2 復(fù)合邏輯運(yùn)算

        1.2.3 正負(fù)邏輯問(wèn)題

        1.3 邏輯門(mén)電路

        1.3.1 晶體管的開(kāi)關(guān)特性

        1.3.2 基本邏輯門(mén)電路

        1.3.3 TTL集成門(mén)電路

        1.3.4 CMOS邏輯電路

        1.4 邏輯函數(shù)的代數(shù)化簡(jiǎn)法

        1.4.1 基本公式和定律

        1.4.2 基本運(yùn)算規(guī)則

        1.4.3 邏輯函數(shù)代數(shù)法化簡(jiǎn)

        1.5 邏輯函數(shù)的卡諾圖化簡(jiǎn)法

        1.5.1 最小項(xiàng)的定義及其性質(zhì)

        1.5.2 卡諾圖

        1.5.3 邏輯函數(shù)的`卡諾圖表示

        1.5.4 邏輯函數(shù)卡諾圖化簡(jiǎn)

        1.5.5 具有約束的邏輯函數(shù)化簡(jiǎn)

        1.6 邏輯函數(shù)的描述方法及轉(zhuǎn)換

        1.6.1 邏輯函數(shù)的描述方法

        1.6.2 幾種描述方法之間的轉(zhuǎn)換

        本章小結(jié)

        習(xí)題

        第2章 組合?輯電路

        2.1 組合邏輯電路的分析與設(shè)計(jì)

        2.1.1 組合邏輯電路的分析

        2.1.2 組合邏輯電路的設(shè)計(jì)

        2.2 組合邏輯電路中的競(jìng)爭(zhēng)冒險(xiǎn)

        2.2.1 產(chǎn)生競(jìng)爭(zhēng)冒險(xiǎn)的原因

        2.2.2 競(jìng)爭(zhēng)冒險(xiǎn)的判斷

        2.2.3 消除競(jìng)爭(zhēng)冒險(xiǎn)的方法

        2.3 加法器與算術(shù)邏輯單元

        2.3.1 半加器和全加器

        2.3.2 集成加法器

        2.3.3 算術(shù)邏輯單元

        2.4 數(shù)值比較器

        2.4.1 數(shù)值比較器的設(shè)計(jì)

        2.4.2 集成數(shù)值比較器

        2.5 編碼器

        2.5.1 編碼器的工作原理

        ?2.5.2 集成優(yōu)先編碼器

        2.6 譯碼器與數(shù)據(jù)分配器

        2.6.1 譯碼器的分析及設(shè)計(jì)

        2.6.2 集成譯碼器

        2.6.3 數(shù)據(jù)分配器

        2.7 數(shù)據(jù)選擇器

        2.7.1 數(shù)據(jù)選擇器的類(lèi)型及功能

        2.7.2 集成數(shù)據(jù)選擇器

        本章小結(jié)

        習(xí)題

        第3章 時(shí)序邏輯基礎(chǔ)

        3.1 RS觸發(fā)器

        3.1.1 Rs觸發(fā)器的工作原理和邏輯功能

        3.1.2 集成RS觸發(fā)器74LS279

        3.1.3 RS觸發(fā)器應(yīng)用

        3.2 D觸發(fā)器

        3.2.1 邏輯電路與邏輯符號(hào)

        3.2.2 工作原理

        3.2.3 ?輯功能描述

        3.2.4 集成D觸發(fā)器74LS74

        3.3 JK觸發(fā)器

        3.3.1 邏輯電路與邏輯符號(hào)

        3.3.2 邏輯功能描述

        3.3.3 集成JK觸發(fā)器

        3.4 T觸發(fā)器

        3.4.1 邏輯電路與邏輯符號(hào)

        3.4.2 邏輯功能描述

        3.5 觸發(fā)器的電氣特性

        本章小結(jié)

        習(xí)題

        第4章 時(shí)序邏輯電路

        第5章 Verilog HDL

        第6章 數(shù)字電路系統(tǒng)設(shè)計(jì)

        第7章 脈沖信號(hào)的產(chǎn)生與變換

        第8章 數(shù)模與模數(shù)轉(zhuǎn)換器

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