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數(shù)字邏輯第四版（毛法堯著）課后習(xí)題答案下載
毛法堯的《數(shù)字邏輯第四版》被列入教育部面向21世紀(jì)課程教材、“九五”國(guó)家級(jí)重點(diǎn)教材。以下是陽(yáng)光網(wǎng)小編為大家整理的數(shù)字邏輯第四版（毛法堯著），僅供大家參考!
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數(shù)字邏輯第四版（毛法堯著）：基本信息
本書(shū)第一版是“教育部面向21世紀(jì)教學(xué)內(nèi)容和課程體系改革”的研究成果，被列入教育部面向21世紀(jì)課程教材、“九五”國(guó)家級(jí)重點(diǎn)教材。第二版被列為“十一五”國(guó)家級(jí)重點(diǎn)教材。
數(shù)字邏輯第四版（毛法堯著）：目錄
目 錄
第一版
第一章 數(shù)制與編碼
1.1 進(jìn)位計(jì)數(shù)制
1.2 數(shù)制轉(zhuǎn)換
1.3 帶符號(hào)數(shù)的代碼表示
1.4 數(shù)的定點(diǎn)表示和浮點(diǎn)表示
1.5 數(shù)碼和字符的代碼表示
第二章 邏輯代數(shù)基礎(chǔ)
2.1 邏輯代數(shù)的基本概念
2.2 邏輯代數(shù)的`公理、定理及規(guī)則
2.3 邏輯函數(shù)表達(dá)式的形式與轉(zhuǎn)換
2.4 邏輯函數(shù)的化簡(jiǎn)
第三章 組合邏輯電路
3.1 邏輯門(mén)電路
3.2 邏輯函數(shù)的實(shí)現(xiàn)
3.3 組合邏輯電路的分析
3.4 組合邏輯電路的設(shè)計(jì)
3.5 組合邏輯電路的競(jìng)爭(zhēng)與冒險(xiǎn)
第四章 同步時(shí)序邏輯電路
4.1 同步時(shí)序邏輯電路模型
4.2 觸發(fā)器
4.3 同步時(shí)序邏輯電路分析
4.4 同步時(shí)序邏輯電路設(shè)計(jì)
4.5 同步時(shí)序邏輯電路設(shè)計(jì)舉例
第五章 異步時(shí)序邏輯電路
5.1 異步時(shí)序邏輯電路模型
5.2 脈沖異步時(shí)序邏輯電路分析和設(shè)計(jì)
5.3 電平異步時(shí)序邏輯電路分析和設(shè)計(jì)
5.4 電平異步時(shí)序邏輯電路的競(jìng)爭(zhēng)與冒險(xiǎn)
5.5 電平異步時(shí)序邏輯電路設(shè)計(jì)舉例
第六章 采用中、大規(guī)模集成電路的邏輯設(shè)計(jì)
6.1 二進(jìn)制并行加法器
6.2 數(shù)值比較器
6.3 譯碼器
6.4 多路選擇器
6.5 計(jì)數(shù)器
6.6 寄存器 6.7 只讀存儲(chǔ)器
6.8 可編程邏輯陣列
6.9 可編程陣列邏輯
6.10 通用陣列邏輯
6.11 高密度可編程邏輯器件
第七章 數(shù)字系統(tǒng)設(shè)計(jì)
7.1 概述
7.2 數(shù)字系統(tǒng)的描述
7.3 基本數(shù)字系統(tǒng)設(shè)計(jì)
7.4 簡(jiǎn)易計(jì)算機(jī)設(shè)計(jì)
第八章 自動(dòng)邏輯綜合
8.1 多維體表示
8.2 多維體的基本運(yùn)算
8.3 多維體運(yùn)算的計(jì)算機(jī)實(shí)現(xiàn)
8.4 組合邏輯電路的計(jì)算機(jī)輔助邏輯設(shè)計(jì)
8.5 同步時(shí)序邏輯電路的計(jì)算機(jī)輔助邏輯設(shè)計(jì)
第九章 邏輯模擬與測(cè)試
9.1 邏輯模擬的模型
9.2 邏輯模擬算法
9.3 故障模擬
9.4 邏輯電路的測(cè)試
9.5 可測(cè)性設(shè)計(jì)
第十章 Verilog HDL語(yǔ)言
10.1 概述
10.2 Verilog HDL語(yǔ)言基本要素
10.3 Verilog HDL語(yǔ)言的基本語(yǔ)句
10.4 Verilog HDL語(yǔ)言的其他結(jié)構(gòu)
10.5 Verilog HDL設(shè)計(jì)方法
第十一章 邏輯器件
11.1 二極管及三極管的開(kāi)關(guān)特性
11.2 三極管反相器
11.3 典型集成TTL“與非”門(mén)電路
11.4 其他類(lèi)型TTL“與非”門(mén)電路
11.5 MOS集成門(mén)電路
11.6 數(shù)字集成電路分類(lèi)、性能及器件名稱(chēng)
參考文獻(xiàn)
第二版
第一章 進(jìn)制與編碼[1]
第二章 邏輯代數(shù)基礎(chǔ)
第三章 組合邏輯電路
第四章 同步時(shí)序邏輯電路
第五章 異步時(shí)序邏輯電路
第六章 采用中、大規(guī)模集成電路的邏輯設(shè)計(jì)
第七章 數(shù)字系統(tǒng)設(shè)計(jì)
第八章 自動(dòng)邏輯綜合
第九章 邏輯模擬與測(cè)試
第十章 Verilog HDL語(yǔ)言
第十一章 邏輯器件
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