數(shù)字電路試卷及答案

　　用數(shù)字信號(hào)完成對(duì)數(shù)字量進(jìn)行算術(shù)運(yùn)算和邏輯運(yùn)算的電路稱為數(shù)字電路，或數(shù)字系統(tǒng)。以下是由陽光網(wǎng)小編整理關(guān)于數(shù)字電路試卷的內(nèi)容，希望大家喜歡!

　　數(shù)字電路試卷及答案(一)

　　一、 填空題 (每空1分，共5分)

　　1、CMOS與非門的未用輸入端應(yīng)連接到邏輯( 1 )電平或者輸入信號(hào)連接端上。

　　2、DAC的功能是將( 數(shù)字 )輸入成正比地轉(zhuǎn)換成模擬輸出。

　　3、5124 EPROM可存儲(chǔ)一個(gè)( 9 )輸入4輸出的真值表。

　　4、74X163的RCO輸出有效條件是：僅當(dāng)使能信號(hào)( ENT )有效，并且計(jì)數(shù)器的狀態(tài)是15。

　　5、已知二進(jìn)制原碼為 ( 001101) 2 , 問 對(duì)應(yīng)的8-bit的補(bǔ)碼為 ( 00001101 )2、

　　二、單項(xiàng)選擇題：從以下題目中選擇唯一正確的答案。(每題2分，共10分)

　　1、八路數(shù)據(jù)分配器的地址輸入端有( B )個(gè)。

　　A、 2 B、 3 C、 4 D、 5

　　2、以下描述一個(gè)邏輯函數(shù)的方法中( C )只能唯一表示。

　　A、表達(dá)式 B、邏輯圖 C、真值表 D、波形圖

　　3、實(shí)現(xiàn)同一功能的.Mealy型同步時(shí)序電路比Moore型同步時(shí)序電路所需要的( B )。

　　A、 狀態(tài)數(shù)目更多 B、 狀態(tài)數(shù)目更少 C、 觸發(fā)器更多 D、 觸發(fā)器更少

　　4、使用移位寄存器產(chǎn)生重復(fù)序列信號(hào)“1000001”，移位寄存器的級(jí)數(shù)至少為( D )。

　　A、 2 B、 3 C、 4 D、5

　　5、下列各邏輯函數(shù)式相等，其中無靜態(tài)冒險(xiǎn)現(xiàn)象的是( D )。

　　A、 F=B’C’+AC+A’B B、 F=A’C’+BC+AB’

　　C、 F=A’C’+BC+AB’+A’B D、 F=B’C’+AC+A’B+BC+AB’+A’C’

　　三、 組合電路分析： (共10分)

　　1、求邏輯函數(shù) FABA'BC'BC 最簡(jiǎn)和之積表達(dá)式。 (4分) 解：FB

　　(2)、 已知邏輯函數(shù) F=W+XZ+XY， 請(qǐng)寫出與該函數(shù)對(duì)應(yīng)的最小項(xiàng)列表表達(dá)式： F=ΣWXYZ( ) (3分)

　　F=ΣWXYZ( 5，6，7，8，9，10，11，12，13，14，15 )

　　數(shù)字電路試卷及答案(二)

　　一、【單項(xiàng)選擇題】(本大題共20小題，每小題2分，共40分)在每小題列出的四個(gè)選項(xiàng)中只有一個(gè)選項(xiàng)是符合題目要求的，請(qǐng)將正確選項(xiàng)前的字母填在答題卷相應(yīng)題號(hào)處。

　　1、對(duì)于鐘控RS觸發(fā)器，若要求其輸出“0”狀態(tài)不變，則輸入的RS信號(hào)應(yīng)為( A )。

　　[A] RS=X0 [B] RS=0X [C] RS=X1 [D] RS=1X

　　2、以下各電路中，( B )可以產(chǎn)生脈沖定時(shí)。

　　[A] 多諧振蕩器 [B] 單穩(wěn)態(tài)觸發(fā)器

　　[C] 施密特觸發(fā)器 [D] 石英晶體多諧振蕩器

　　3、下列邏輯電路中為時(shí)序邏輯電路的是( C )。

　　[A] 變量譯碼器 [B] 加法器 [C] 數(shù)碼寄存器 [D] 數(shù)據(jù)選擇器

　　4、同步時(shí)序電路和異步時(shí)序電路比較，其差異在于后者( B )。

　　[A] 沒有觸發(fā)器 [B] 沒有統(tǒng)一的時(shí)鐘脈沖控制

　　[C] 沒有穩(wěn)定狀態(tài) [D] 輸出只與內(nèi)部狀態(tài)有關(guān)

　　5、當(dāng)用專用輸出結(jié)構(gòu)的PAL設(shè)計(jì)時(shí)序邏輯電路時(shí)，必須還要具備有( A )。

　　[A] 觸發(fā)器 [B] 晶體管 [C] MOS管 [D] 電容

　　6、能將輸出端直接相接完成線與的電路有( C )。

　　[A] TTL與門 [B] 或門 [C] 三態(tài)門 [D] 三極管非門

　　7、TTL與非門的多余腳懸空等效于( A )。

　　[A] 1 [B] 0 [C] Vcc [D] Vee

　　8、以下哪一條不是消除竟?fàn)幟半U(xiǎn)的措施( B )。

　　[A] 接入濾波電路 [B] 利用觸發(fā)器 [C] 加入選通脈沖 [D] 修改邏輯設(shè)計(jì)

　　9、主從觸發(fā)器的觸發(fā)方式是( D )。

　　[A] CP=1 [B] CP上升沿 [C] CP下降沿 [D] 分兩次處理

　　10、組合型PLA是由( A )構(gòu)成。

　　[A] 與門陣列和或門陣列 [B] 一個(gè)計(jì)數(shù)器

　　[C] 一個(gè)或陣列 [D] 一個(gè)寄存器

　　11、下列四個(gè)數(shù)中，最大的數(shù)是( B )。

　　[A] (AF)16 [B] (001010000010)8421BCD

　　[C] (10100000)2 [D] (198)10

　　12、觸發(fā)器有兩個(gè)穩(wěn)態(tài)，存儲(chǔ)8位二進(jìn)制信息要( B )個(gè)觸發(fā)器。

　　[A] 2 [B] 8 [C] 16 [D] 32

　　13、下列門電路屬于雙極型的是( A )。

　　[A] OC門 [B] PMOS [C] NMOS [D] CMOS

　　14、用異步I/O輸出結(jié)構(gòu)的PAL設(shè)計(jì)邏輯電路，它們相當(dāng)于( A )。

　　[A] 組合邏輯電路 [B] 時(shí)序邏輯電路

　　[C] 存儲(chǔ)器 [D] 數(shù)模轉(zhuǎn)換器

　　15、要構(gòu)成容量為4K×8的RAM，需要( D )片容量為256×4的RAM。

　　[A] 2 [B] 4 [C] 8 [D] 32

　　16、74LS160十進(jìn)制計(jì)數(shù)器它含有的觸發(fā)器的個(gè)數(shù)是( C )。

　　[A] 1 [B] 2 [C] 4 [D] 6

　　17、ROM電路由地址譯碼器和存儲(chǔ)體構(gòu)成，若譯碼器有十個(gè)地址輸入線，則最多可( C )個(gè)字。

　　[A] 10 [B] 102 [C] 210 [D] 104

　　18、n級(jí)觸發(fā)器構(gòu)成的環(huán)形計(jì)數(shù)器，其有效循環(huán)的狀態(tài)數(shù)為( A )。

　　[A] n個(gè) [B] 2n個(gè) [C] 2n-1個(gè) [D] 2n個(gè)

　　19、Moore和Mealy型時(shí)序電路的本質(zhì)區(qū)別是( A )。

　　[A] 沒有輸入變量

　　[B] 當(dāng)時(shí)的輸出只和當(dāng)時(shí)電路的狀態(tài)有關(guān)，和當(dāng)時(shí)的.輸入無關(guān)

　　[C] 沒有輸出變量

　　[D] 當(dāng)時(shí)的輸出只和當(dāng)時(shí)的輸入有關(guān)，和當(dāng)時(shí)的電路狀態(tài)無關(guān)器

　　20、相同計(jì)數(shù)模的異步計(jì)數(shù)器和同步計(jì)數(shù)器相比，一般情況下( A )。

　　[A] 驅(qū)動(dòng)方程簡(jiǎn)單 [B] 使用觸發(fā)器的個(gè)數(shù)少

　　[C] 工作速度快 [D] 以上說法都不對(duì)

　　二、【填空題】(本大題共10小題，每小題2分，共20分;請(qǐng)將答案填寫在答題卷相應(yīng)題號(hào)處)

　　21、(1111101、01001111)2=( 7D、4F )16，(6840)10=( 110100001000000 )8421BCD

　　22、對(duì)160個(gè)符號(hào)進(jìn)行二進(jìn)制編碼，則至少需要( 8 )位二進(jìn)制數(shù)。

　　23、邏輯函數(shù) F=AB?BC的最小項(xiàng)之和表達(dá)式為。 ?m(0,1,3,7) )(F?ABC?ABC?ABC?ABC?

　　24、三態(tài)門除了輸出高電平和低電平之外，還有第三種輸出狀態(tài)，即( 高阻 )狀態(tài)。

　　25、邏輯門電路能夠驅(qū)動(dòng)同類負(fù)載門的個(gè)數(shù)稱為( 扇出系數(shù) )。

　　26、可以用( 紫外線 )擦除EPROM中所存的信息。

　　27、單穩(wěn)態(tài)觸發(fā)器可應(yīng)用于( 分頻 )、延時(shí)、( 定時(shí) )。

　　28、邏輯代數(shù)又稱布爾代數(shù)�；�本的邏輯關(guān)系有( 與 )、( 或 )、( 非)三種。

　　29、時(shí)序邏輯電路按照其觸發(fā)器是否有統(tǒng)一的時(shí)鐘控制分為( 同步 )時(shí)序電路和( 異步 )時(shí)序電路。

　　30、存儲(chǔ)器的( 存儲(chǔ)容量)和(存儲(chǔ)時(shí)間 )是反映系統(tǒng)性能的兩個(gè)重要指標(biāo)。

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